模拟与数字电路实验(张俊霞, 卢建良, 赵雅楠...) 2021秋  课程号:01115201
2021秋  课程号:01115201
10.0(4人评价)
  • 课程难度:中等
  • 作业多少:很多
  • 给分好坏:超好
  • 收获大小:很多
选课类别:计划 教学类型:实验课
课程类别:本科计划内课程 开课单位:计算机科学与技术系
课程层次:专业基础 学分:1.0
课程主页:暂无(如果你知道,劳烦告诉我们!)
简介 最后更新:

数字逻辑电路实验是计算机专业硬件设计所必修的专业基础课,目的在于训练学生掌握EDA数字电路的设计技术的分析和应用,掌握硬件描述语言Verilog HDL的分析与应用。熟练掌握计算机局部逻辑的设计和调试方法。所有实验都是设计性的,实验老师会就实验题目,实验原理和具体的要求 作必要得讲解,学生按要求做自己的分析,进行比较,自行设计出最佳的方案 ,在此基础上学生可自选器件(TTL,GAL,FPGA)等芯片构成电路 进行分析和调试,在得到正确的实验结果后由老师检查确认后,写出实验报告,方能通过实验。 此举不仅较好的提高了学生分析和解决问题的能力,也为后边的计算机原理和体系结构实验打下一个坚实的基础。

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  • 课程难度:中等
  • 作业多少:很多
  • 给分好坏:一般
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  • 难度:中等
  • 作业:很多
  • 给分:一般
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本人参加了提高班,授课老师是张俊霞。

个人感觉与普通班相比,提高班的内容和难度都与理论课更加匹配,实验内容包括编码器与译码器(对应理论课课本的4.4.1和4.4.2)、运算器与寄存器(4.4.4、4.4.5、第5章)、有限状态机(6.3)、计数器(内容还包括按钮去抖动和取信号上升沿,顺带学习了LED数码管的刷新显示)(6.5)、寄存器堆(需要用有限状态机对寄存器堆中的数据的排序)(第7章、第11章)、存储器(与理论课关系较小,介绍VGA口的协议);而据我的粗略了解,普通班的实验几乎是简单乏味的Logisim和Vivado操作方法训练,一学期下来疲于撰写冗长的实验报告,收获甚微。提高班的实验在Nexys4 DDR开发板上完成,而不像普通班那样需要使用时好时坏的VLab和FPGA在线。

提高班的大多数实验的难度并不大,至少涉及的内容没有超出理论课的范围,而且也没有卷的空间,大约课上时间外加8个小时就可以完成操作和报告。提高班的实验报告更加注重对实验内容的理解,而不像普通班的报告那样需要用屏幕截图详细地记录实验步骤。助教检查实验时也不会问刁钻的问题。

然而实验5寄存器堆有巨大的内卷空间,实验的核心任务是在尽可能少的时钟周期内完成对寄存器文件中的32个uint16的排序。如果不想卷可以用冒泡排序在12小时内比较轻松的完成。可是如果想卷$O(n\ln n)$时间的排序算法,那复杂程度和耗时恐怕就是无底洞了,比如我自己挑了相对简单的非递归归并排序(真正的基于迭代的归并排序,不是某些数据结构老师常说的用栈实现的自欺欺人的非递归),整个实验共花费23h37m。

当然,提高班最可怕的实验非综合设计莫属,由于这学期老师没有限定实验范围(据老师说上学期要求写任意数量的整数的排序,唯一的可卷之处是排序算法),于是最后的作品可谓百花齐放、无奇不有,有的小组做了视频和音频播放器,有的实现了大素数的生成器,还有不少小组做了有流畅画面的2D游戏,相比之下,实现不带trap和中断的LC-3电路都算是相对简单的作品了。

虽然这门课占用的时间确实稍多,但是以2020级的精简过的培养方案,还是可以腾出足够的时间做实验的。提高班的总体难度并不算高,而且只要能全程坚持下来(主要是实验5和综合设计能按时完成),最后的分数是很好的。

最后,建议满足以下条件之一的同学报名提高班:

  • 对数字电路感兴趣;
  • 想接触FPGA开发板实物;
  • 不想在实现报告中写冗长的实验步骤;
  • 想卷GPA。

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wloner 2021秋
  • 课程难度:困难
  • 作业多少:很多
  • 给分好坏:超好
  • 收获大小:很多
  • 难度:困难
  • 作业:很多
  • 给分:超好
  • 收获:很多

希望像我一样的普通学生不要入坑提高班了

会变得不幸😭😭😭

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topusername 2021秋
  • 课程难度:困难
  • 作业多少:很多
  • 给分好坏:超好
  • 收获大小:很多
  • 难度:困难
  • 作业:很多
  • 给分:超好
  • 收获:很多

高赞回答已经写的很明白了,我就主要评个分。 我参加的是高级班,学到了很多有用的知识。个人一点建议就是在保持课程量不变的情况下将1学分增至2学分,能客观地体现这门课的任务量。或者普通班1学分,高级班2学分? 注:高级班优秀率80%,普通班优秀率30%。数据来源:张俊霞老师。

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张俊霞

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卢建良

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赵雅楠

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樊彦恩

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